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我正在做一些 Makefile 重构,并试图找出最简洁的方法来实现一个 Makefile,它执行以下操作:
...
OBJ_DIR = obj/
BIN_DIR = bin/
PROGRAM = program
SRCS = test1.cpp test2.c
OBJS = $(addprefix $(OBJ_DIR), \
$(patsubst %.cpp, %.o, \
$(patsubst %.c, %.o, $(SRCS))))
$(BIN_DIR)$(PROGRAM) : $(OBJS)
$(CREATE_OUT_DIR)
$(LINK)
$(OBJ_DIR)%.o : %.c
$(CREATE_OBJ_DIR)
$(CCOMPILE)
$(OBJ_DIR)%.o : %.cpp
$(CREATE_OBJ_DIR)
$(CPPCOMPILE)
...
$(OBJS): | $(OBJ_DIR)
$(OBJ_DIR):
$(CREATE_OBJ_DIR)
最佳答案
你似乎已经解决了你的第一点:将它们全部放在一个变量中(我不应该认为你真的需要像你一样将它们分成 TEMP1 和 TEMP2,只是有不同的构建规则)
对于第二点,您可以告诉编译器在哪里输出目标文件(对于 g++,它是这样的:
g++ -c MySourceFile.cpp -o obj/MySourceFile.o
obj/%.o: %.cpp
g++ -c $*.cpp -o obj/$*.o
obj:
mkdir obj
$(BIN_DIR)$(PROGRAM) : $(BIN_DIR) $(OBJS)
$(LINK)
$(BIN_DIR):
$(CREATE_OUT_DIR)
关于makefile - 简洁的 Makefile,我们在Stack Overflow上找到一个类似的问题: https://stackoverflow.com/questions/5325883/
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