system-verilog - 静态任务函数声明中的引用参数是非法的是什么意思？

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program main(); 
int a; 

initial 
begin 
#10 a = 10; 
#10 a = 20; 
#10 a = 30; 
#10 $finish; 
end 

task pass_by_val(int i); 
forever 
@i $display("pass_by_val: I is %0d",i); 
endtask 


task pass_by_ref(ref int i); 
forever 
@i $display("pass_by_ref: I is %0d",i); 
endtask 

initial 
pass_by_val(a); 

initial 
pass_by_ref(a);

我指的是上面的网站并运行，但我有一些这样的错误消息。

Reference argument is illegal inside static task function declaration.

Answer 1

通常模块/程序内的任务/函数默认是静态的，根据第 13.5.2 节通过引用传递 IEEE 1800 - 2012

It shall be illegal to use argument passing by reference for subroutines with a lifetime of static.

要解决仅使用引用传递 'ref' 到自动任务/函数的问题

task automatic pass_by_ref(ref int i); 
forever 
@i $display("pass_by_ref: I is %0d",i); 
endtask