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我正在设计 TTL 串行计算机,我正在努力选择更适合 LLVM 编译器后端的架构(我希望能够在那里运行任何 C++ 软件)。将没有 MMU,没有乘法/除法,没有硬件堆栈,没有中断。
我有两个主要选择:
1) 8 位内存、8 位 ALU、8 位寄存器 (~12-16)。内存地址宽度 24 位。所以我需要使用 3 个寄存器作为 IP 和 3 个寄存器用于任何内存位置。
不用说,在编译器中实现任何地址计算都是非常痛苦的。
2) 24 位内存、24 位 ALU、24 位寄存器 (~6-8)。平淡的内存,不错。缺点是由于设计的串行性质,即使我们对某些 bool 值进行操作,每次操作也需要多花 3 倍的时钟。 24 位内存数据宽度很昂贵。而且一般来说在硬件中实现起来更难。
问题是:您认为在这个 8 位、基于无堆栈的硬件上实现所有 C++ 功能是可能的,还是我需要更复杂的硬件才能生成质量和速度合理的代码?
最佳答案
我支持使用 LCC 的建议。我在这个自制的 16 位 RISC 项目中使用了它:http://fpgacpu.org/xsoc/cc.html .
我认为无论是构建 8 位变体并使用 3 个带进位的加法来增加 IP,还是 24 位变体并在硬件中完成整个操作,这应该没有太大区别。您可以隐藏汇编程序中的差异。
如果你看我上面的文章,或者更简单的 CPU:http://fpgacpu.org/papers/soc-gr0040-paper.pdf你会发现你真的不需要那么多运算符/指令来覆盖整数 C 语言。事实上,有一个 lcc 实用程序 (ops) 可以打印给定机器的最小运算符集。
有关更多信息,请参阅我关于将 lcc 移植到新机器的文章:http://www.fpgacpu.org/usenet/lcc.html
一旦我移植了 lcc,我就编写了一个汇编程序,它从基本指令中合成了更大的指令集。例如,我的机器有 load-byte-unsigned 但没有 load-byte-signed,所以我发出了这个序列:
lbs rd,imm(rs) ->
lbu rd,imm(rs)
lea r1,0x80
xor rd,r1
sub rd,r1
registers
load register with constant
load rd = *rs
store *rs1 = rs2
+ - (w/ w/o carry) // actually can to + with - and ^
>> 1 // << 1 is just +
& ^ // (synthesize ~ from ^, | from & and ^)
jump-and-link rd,rs // rd = pc, pc = rs
skip-z/nz/n/nn rs // skip next insn on rs==0, !=0, <0, >=0
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