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我正在对 verilog 构建的数字逻辑进行仿真,需要经常重新启动仿真才能看到变化。我正在使用 Cadence SimVision 查看波形。
有没有办法在 SimVision 环境中用 verilog 编写命令?我指的是探针和参数之类的东西。
最佳答案
它不是 Verilog,但您可以创建一个 tcl 文件。
shm.tcl:
database -open waves -shm
probe -create your_top_level -depth all -all -shm -database waves
run
exit
现在运行你的模拟使用:
irun -access +r testcase.sv -input shm.tcl
关于verilog - 在 Verilog 代码中为 SimVision 设置探针,我们在Stack Overflow上找到一个类似的问题: https://stackoverflow.com/questions/28407882/
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