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verilog，参数的二进制长度

转载作者：行者123 更新时间：2023-12-02 17:11:39

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我的模块获取一个参数，我希望在我的代码中有一个该值的计数器。例如，参数 n=16，我想定义 reg [x:0] i，这样我就可以数到 n。我怎样才能找到x？应该有一个真正简单的方法吗？

最佳答案

有几个选项，具体取决于您的工具支持的内容。

编写您自己的 log2 函数
使用$clog2

这里有一个很长的讨论:http://www.rhinocerus.net/forum/lang-verilog/646074-how-get-bit-width-value-verilog-compile-time.html

关于verilog，参数的二进制长度，我们在Stack Overflow上找到一个类似的问题： https://stackoverflow.com/questions/13780668/

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