riscv - 为 RISC-V 设置 mstatus 寄存器-6ren

riscv - 为 RISC-V 设置 mstatus 寄存器

转载作者：行者123 更新时间：2023-12-01 08:53:08

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我正在尝试使用另一个寄存器 t1 加载 mstatus。

 lw t1, mstatus              # load mstatys register into t1
 xori t1, t1, 0x8            # xor mstatus to set 3rd bit and leave everything else as is
 lw mstatus, t1              # set mstatus

初始 lw t1, mstatus工作得很好。然而，当试图 lw mstatus, t1汇编程序给出

Error: illegal operands 'lw mstatus, t1'

我不知道是什么导致了这个错误，mstatus 寄存器是一个读/写寄存器。它应该工作。

最佳答案

mstatus不是内存部分。然后它不能在通用寄存器(x1-x31)下使用 lw/sw 指令加载/存储。
mstatus是通过控制和状态寄存器指令访问的 CSR(配置状态寄存器)的一部分(参见 riscv-spec 的第 2.8 章)。

然后加载 mstatus您应该使用 csrrs/c 指令并根据您想要执行的操作编写 csrrw 指令，您也可以只清除/设置寄存器的单个位。

将 t1 写入 mstatus并且不关心 mstatus旧值 (x0):

csrrw t1, mstatus, x0

读取 t1 中的 mstatus 并且不要触摸 mstatus 值:

csrrs x0, mstatus, t1

或者

csrrc x0, mstatus, t1

关于riscv - 为 RISC-V 设置 mstatus 寄存器，我们在Stack Overflow上找到一个类似的问题： https://stackoverflow.com/questions/59524849/

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