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c - 当不与核心 Hook 时,应用程序运行速度更快

转载 作者:可可西里 更新时间:2023-11-01 11:47:38 25 4
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我有一个带有 4 个线程的应用程序,我在带有 CentOS 的 8 核 Intel 处理器上运行。当我运行它的两个实例时,这两个实例的总运行速度比 1 个实例快。此外,对于两个实例,当我不将每个线程绑定(bind)到不同的核心并将调度留给调度程序时,它们运行得更快。

按照该逻辑,也许一个实例也运行缓慢,因为调度程序已将所有 4 个线程固定到 4 个独立的内核。当我固定 2 个实例的每个线程时,即 8 个线程固定到 8 个内核时,这两个实例的总和也与一个实例花费的时间大致相同。

应用程序是锁密集型的,因为有频繁的共享内存访问。另请注意,否则 CPU 开销保持为 0%,因此几乎没有其他进程消耗周期。

现在我的问题是这里发生了什么?我想到的一种解释是,当线程被固定到不同的内核时,它们几乎同时尝试获取互斥锁,结果发生了高竞争,但是当它们被调度程序调度时,它们可能会尝试在稍微不同的时间获取互斥体,从而减少争用。

任何意见!这真的很奇怪,因为留给调度程序,一个实例的运行速度比两个实例加起来还要慢。如何编译我的基准测试结果。没有人会相信我!

/proc/cpuinfo 给出的处理器信息如下。

processor   : 0
vendor_id : GenuineIntel
cpu family : 6
model : 26
model name : Intel(R) Xeon(R) CPU X5550 @ 2.67GHz
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power management: [8]

processor : 1
vendor_id : GenuineIntel
cpu family : 6
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model name : Intel(R) Xeon(R) CPU X5550 @ 2.67GHz
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cpu MHz : 2660.076
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physical id : 0
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cpu cores : 4
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fpu : yes
fpu_exception : yes
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cache_alignment : 64
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power management: [8]

processor : 2
vendor_id : GenuineIntel
cpu family : 6
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cache_alignment : 64
address sizes : 40 bits physical, 48 bits virtual
power management: [8]

processor : 3
vendor_id : GenuineIntel
cpu family : 6
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address sizes : 40 bits physical, 48 bits virtual
power management: [8]

processor : 4
vendor_id : GenuineIntel
cpu family : 6
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power management: [8]

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address sizes : 40 bits physical, 48 bits virtual
power management: [8]

processor : 6
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cpu family : 6
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model name : Intel(R) Xeon(R) CPU X5550 @ 2.67GHz
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address sizes : 40 bits physical, 48 bits virtual
power management: [8]

processor : 7
vendor_id : GenuineIntel
cpu family : 6
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model name : Intel(R) Xeon(R) CPU X5550 @ 2.67GHz
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clflush size : 64
cache_alignment : 64
address sizes : 40 bits physical, 48 bits virtual
power management: [8]

processor : 8
vendor_id : GenuineIntel
cpu family : 6
model : 26
model name : Intel(R) Xeon(R) CPU X5550 @ 2.67GHz
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cache_alignment : 64
address sizes : 40 bits physical, 48 bits virtual
power management: [8]

processor : 9
vendor_id : GenuineIntel
cpu family : 6
model : 26
model name : Intel(R) Xeon(R) CPU X5550 @ 2.67GHz
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cpu MHz : 2660.076
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siblings : 8
core id : 0
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bogomips : 5320.07
clflush size : 64
cache_alignment : 64
address sizes : 40 bits physical, 48 bits virtual
power management: [8]

processor : 10
vendor_id : GenuineIntel
cpu family : 6
model : 26
model name : Intel(R) Xeon(R) CPU X5550 @ 2.67GHz
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cpu MHz : 2660.076
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siblings : 8
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bogomips : 5320.04
clflush size : 64
cache_alignment : 64
address sizes : 40 bits physical, 48 bits virtual
power management: [8]

processor : 11
vendor_id : GenuineIntel
cpu family : 6
model : 26
model name : Intel(R) Xeon(R) CPU X5550 @ 2.67GHz
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cpu MHz : 2660.076
cache size : 8192 KB
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siblings : 8
core id : 1
cpu cores : 4
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fpu : yes
fpu_exception : yes
cpuid level : 11
wp : yes
flags : fpu vme de pse tsc msr pae mce cx8 apic sep mtrr pge mca cmov pat pse36 clflush dts acpi mmx fxsr sse sse2 ss ht tm syscall nx rdtscp lm constant_tsc ida nonstop_tsc pni monitor ds_cpl vmx est tm2 ssse3 cx16 xtpr sse4_1 sse4_2 popcnt lahf_lm
bogomips : 5320.00
clflush size : 64
cache_alignment : 64
address sizes : 40 bits physical, 48 bits virtual
power management: [8]

processor : 12
vendor_id : GenuineIntel
cpu family : 6
model : 26
model name : Intel(R) Xeon(R) CPU X5550 @ 2.67GHz
stepping : 5
cpu MHz : 2660.076
cache size : 8192 KB
physical id : 1
siblings : 8
core id : 2
cpu cores : 4
apicid : 21
fpu : yes
fpu_exception : yes
cpuid level : 11
wp : yes
flags : fpu vme de pse tsc msr pae mce cx8 apic sep mtrr pge mca cmov pat pse36 clflush dts acpi mmx fxsr sse sse2 ss ht tm syscall nx rdtscp lm constant_tsc ida nonstop_tsc pni monitor ds_cpl vmx est tm2 ssse3 cx16 xtpr sse4_1 sse4_2 popcnt lahf_lm
bogomips : 5320.03
clflush size : 64
cache_alignment : 64
address sizes : 40 bits physical, 48 bits virtual
power management: [8]

processor : 13
vendor_id : GenuineIntel
cpu family : 6
model : 26
model name : Intel(R) Xeon(R) CPU X5550 @ 2.67GHz
stepping : 5
cpu MHz : 2660.076
cache size : 8192 KB
physical id : 0
siblings : 8
core id : 2
cpu cores : 4
apicid : 5
fpu : yes
fpu_exception : yes
cpuid level : 11
wp : yes
flags : fpu vme de pse tsc msr pae mce cx8 apic sep mtrr pge mca cmov pat pse36 clflush dts acpi mmx fxsr sse sse2 ss ht tm syscall nx rdtscp lm constant_tsc ida nonstop_tsc pni monitor ds_cpl vmx est tm2 ssse3 cx16 xtpr sse4_1 sse4_2 popcnt lahf_lm
bogomips : 5320.05
clflush size : 64
cache_alignment : 64
address sizes : 40 bits physical, 48 bits virtual
power management: [8]

processor : 14
vendor_id : GenuineIntel
cpu family : 6
model : 26
model name : Intel(R) Xeon(R) CPU X5550 @ 2.67GHz
stepping : 5
cpu MHz : 2660.076
cache size : 8192 KB
physical id : 1
siblings : 8
core id : 3
cpu cores : 4
apicid : 23
fpu : yes
fpu_exception : yes
cpuid level : 11
wp : yes
flags : fpu vme de pse tsc msr pae mce cx8 apic sep mtrr pge mca cmov pat pse36 clflush dts acpi mmx fxsr sse sse2 ss ht tm syscall nx rdtscp lm constant_tsc ida nonstop_tsc pni monitor ds_cpl vmx est tm2 ssse3 cx16 xtpr sse4_1 sse4_2 popcnt lahf_lm
bogomips : 5320.02
clflush size : 64
cache_alignment : 64
address sizes : 40 bits physical, 48 bits virtual
power management: [8]

processor : 15
vendor_id : GenuineIntel
cpu family : 6
model : 26
model name : Intel(R) Xeon(R) CPU X5550 @ 2.67GHz
stepping : 5
cpu MHz : 2660.076
cache size : 8192 KB
physical id : 0
siblings : 8
core id : 3
cpu cores : 4
apicid : 7
fpu : yes
fpu_exception : yes
cpuid level : 11
wp : yes
flags : fpu vme de pse tsc msr pae mce cx8 apic sep mtrr pge mca cmov pat pse36 clflush dts acpi mmx fxsr sse sse2 ss ht tm syscall nx rdtscp lm constant_tsc ida nonstop_tsc pni monitor ds_cpl vmx est tm2 ssse3 cx16 xtpr sse4_1 sse4_2 popcnt lahf_lm
bogomips : 5320.04
clflush size : 64
cache_alignment : 64
address sizes : 40 bits physical, 48 bits virtual
power management: [8]

最佳答案

一种解释是缓存和内存架构;和数据局部性。

根据英特尔的规范查找器,对于您的 X5550 CPU,每个物理芯片有 4 个内核(和 8 个逻辑 CPU)。如果你有 16 个逻辑 CPU,那么你就有 2 个物理芯片(这对于 Xeon 来说是完全可能的)。更多研究表明,每个内核都有自己的 L1 和 L2 缓存,由该内核中的两个逻辑 CPU 共享;每个物理芯片都有 8 MiB 的 L3 缓存,由该芯片上的所有 4 个内核(8 个逻辑 CPU)共享。

如果逻辑 CPU 0 和 1 共享一个 L2 缓存,而逻辑 CPU 2 和 3 共享一个单独的 L2 缓存,那么修改同一内存的 2 个线程可能在逻辑 CPU 0 和 1(而不是逻辑 CPU 0 和 2)上运行得更好因为数据在一个缓存中保持“独占”状态(并且不会在不同的二级缓存之间反弹)。

同理,如果前八个逻辑CPU共享一个三级缓存,而另一组八个逻辑CPU共享一个三级缓存,那么8个线程修改同一内存可能会在限制在一组逻辑CPU时运行得更好(而不是分布在具有单独的 L3 缓存的单独的物理芯片上)。

另一件事是,使用一对“Xeon X550”CPU,您的计算机极有可能是 ccNUMA。两个独立的内存条,其中一个内存条直接连接到第一个物理 CPU,另一个内存条直接连接到第二个物理 CPU。在这种情况下,当一个 CPU 试图访问未直接连接到该 CPU 的 RAM 时,它需要请求另一个 CPU(连接 RAM 的地方)来获取它(而不是能够自己获取它),并且这会降低性能(大约“慢 15%”)。

Linux 确实有特殊的支持 ccNUMA 系统。它将尝试将每个进程(及其所有线程)限制在一组特定的 CPU 上,并分配直接连接到这些 CPU 的内存;试图避免“大约慢 15%”的性能损失。

如果将所有这些结合起来,一个具有 8 个线程的进程受 CPU 限制并不断争夺相同的锁(修改这些锁所在的缓存行)可能会在前 8 个逻辑 CPU 或后 8 个逻辑 CPU 上运行得更好逻辑 CPU;如果您尝试将进程的线程平均分布在逻辑 CPU(例如 CPU 0、2 、4、6、8、10 等)。

关于c - 当不与核心 Hook 时,应用程序运行速度更快,我们在Stack Overflow上找到一个类似的问题: https://stackoverflow.com/questions/7287498/

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